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NCP4307 — 04 设计要点、常见陷阱与故障排查

手册依据:NCP4307/D(布局相关要求来自 DS 引脚表/应用信息;标注“业界经验/推断”处为工程惯例总结,DS 未明确处均已标出)。波形核对方法可直接使用 DS 图 72/78 给出的官方测试法。

本篇总结

  1. NCP4307 的故障模式高度集中:多数问题源于“CS/GND 检测路径引入干扰”——它是把 200 V 功率节点当输入的芯片,任何串入检测路径的阻抗都会成为“假信号源”。
  2. 时间档位(t_ON_MIN/t_OFF_MIN)是量产固化的:档位选错不能靠改外围救,只能换 OPN——所以版本核对要放在打样前(03 篇步骤 4 的双向核算)。
  3. CS 脚上禁止加 RC 滤波:−dV/dt 判据要求 3.0→0.5 V 在 15~45 ns 内完成,任何滤波都直接拆掉这层防御,同时抬高关断延迟。
  4. TRIG/DIS 的“100 µs 禁止”既是功能也是隐患:任何持续 >100 µs 的拉高都是待机指令(含保护电路的锁死信号、慢 RC 的上电波形)。
  5. 高侧自供电的陷阱在“能量断续”:漏极高压期才有 105 mA,V_CCL 电容不够大就 UVLO 抖动,故障表现是“轻载正常、重载掉链子”。
  6. 排查总纲:先看供电(UVLO/禁止/LLD 四种正常休眠态),再看判据(四根旗线谁先动),最后才怀疑 IC——NCP4307 本身极少是问题根源。

1. 常见陷阱(陷阱 → 机理 → 现场现象 → 怎么测 → 怎么解)

陷阱 1:GND 未做开尔文连接,直接搭接功率地

陷阱 2:CS 感应点不在漏极焊盘(搭接在绕组/中间点)

陷阱 3:CS 上加 RC 滤波“图稳”

陷阱 4:版本档位与振铃周期错配

陷阱 5:TRIG/DIS 上的“意外待机”

陷阱 6:高侧自供电的 V_CCL 电容不够

陷阱 7:轻载第一拍被“深振铃”打假关断

陷阱 8:CCM 只靠 CS 判据关断,交叉导通发热

陷阱 9(补充):TRIG/DIS 复用 +dV/dt 时忘了“脚功能已改”

陷阱 10(补充):热预算按“驱动损耗忽略不计”处理

2. 排查流程树

SR 系统异常(不开通 / 假动作 / 过热)
│
├─ 第一步:供电合法吗?
│   ├─ V_CCL < 4.0 V typ? ──→ UVLO 休眠(50 µA 级)→ 查供电架构(陷阱 6)
│   ├─ TRIG 高 >100 µs? ──→ 禁止模式(45 µA 级)→ 查陷阱 5
│   └─ V_CS >100 mV 超 100 µs? ──→ LLD 轻载(185 µA 级)→ 正常行为,查负载判定
│
├─ 第二步:SR 完全不开通?
│   ├─ CS 对漏极连通性 + 感应点(陷阱 2)
│   ├─ I_PK×R_DS_ON 是否越过 −40 mV(开通判据覆盖,03 篇步骤 2)
│   └─ DRV 线/栅极电阻/管子完好性
│
├─ 第三步:假开通/假关断(间歇性)?
│   ├─ 同屏 V_DS(SR)+V_G(SR)+I_SEC,按 DS 图 61/62 时序模板逐段对
│   ├─ 开通期毛刺 → t_ON_INIT_BLK/t_CS_OFF_BLK 档位 vs 振铃(陷阱 4)
│   ├─ 关断后振铃谷 → t_OFF_MIN + RES_CMP 重触发是否正常(02 篇 §6)
│   └─ GND/CS 检测路径污染(陷阱 1/陷阱 2)→ 差分探头量化共阻抗压降
│
├─ 第四步:特定工况(5 V 高线 / ACF 过渡 / CCM 重载)?
│   ├─ 5 V 高线漏导通 → −dV/dt 是否启用(FA/AA),CS 沿跌落 ≤档位 ns(陷阱 3)
│   ├─ ACF 重载过渡 → AA 版 +dV/dt 网络与斜率门槛(陷阱 9/03 篇步骤 6)
│   └─ CCM 重载发热 → DS 图 72 使能/禁止对比法(陷阱 8)
│
└─ 第五步:以上全排除 → 换已知好 IC 复测(IC 本体故障率最低,业界经验)

2.5 测量注意(排查前先确认工具没问题)

次级节点的测量本身就可能制造假象——先把量法做对,再谈排障(业界经验):

3. 布局要点

CS 感应点:

开尔文连接(DRV/GND 回路):

地环路:

4. 量产检查清单

# 检查项 方法/判据 出处
1 CS 感应点位置 目检 + 探针对比:CS 脚波形 = 漏极焊盘波形 陷阱 2
2 GND 开尔文 GND 脚-源极焊盘间尖峰 <50 mV(业界经验值) DS 引脚表 + 陷阱 1
3 V_CCL 供电 直连:≥UVLO max 4.2 V + 余量;自供电:纹波不触 UVLO DS §8.1
4 TRIG/DIS 静态电平 固定接 GND(正)/V_CCL(负),无毛刺越 2.3 V DS §8.4
5 CS 沿跌落时间 3.0→0.5 V ≤ t_CS_−DVDT 档位(15/25/35/45 ns) DS §8.3
6 振铃衰减 vs t_OFF_MIN 振铃衰减期 < 档位 < 最短周期间隔 DS §9.5/§9.6
7 CCM 交叉导通 DS 图 72 对比法:使能/禁止波形相似 DS §9.8
8 LLD/突发行为 DS 图 78 法:突发恢复第一拍不被假关断 DS §9.10
9 待机功耗 禁止态输入电流 ≤70 µA max(IC 部分) DS §8.1
10 热成像 T_J 推算 ≤105~110 °C(留 TSD 170 °C 裕量,业界经验) DS §6/§8.3
11 −dV/dt 现场验证 5 V 档高线:确认无“漏一拍”(SR 每个次级导通相都接管) DS §9.6

5. 实战问答

Q1:自同步会不会和初级失步? 不会“失步”,因为根本没有“步”可失——同步信息就是“次级电流是否真的在流”。真正的风险不是失步,而是判据被假信号欺骗(振铃/噪声),而这三层判据+消隐就是为这个准备的。异常工况(深 CCM、ACF 过渡)才需要 TRIG/+dV/dt 介入。

Q2:轻载要不要专门处理? LLD 是自动的(100 mV/100 µs 判据),外围无需动作。要做的只有两件事:确认突发恢复第一拍不被假关断(DS 图 78 法)、确认待机功耗预算里 IC 只占 45~185 µA 这一小块。

Q3:和 MP6908/MP6951 怎么选(现场速答)? 常规 DCM/CCM/QR 反激、几十~几百 kHz:NCP4307 与 MP6908 都行——NCP4307 胜在 0 mV 关断与三层判据的免整定,MP6908 胜在 HVC 自取电与 0 V 输出能力;≥500 kHz ZVS/ACF:MP6951 的时间窗更稳(见 横评)。

精炼要点

要点 数值 为什么重要
检测路径神圣不可污染 CS 直连漏极、GND 开尔文接源极 全部判据的可信度建立在“CS=V_DS、GND=源极电位”上
CS 上没有滤波 3.0→0.5 V ≤15~45 ns −dV/dt 判据的物理前提
档位是固化的 t_ON/t_OFF ±10%,8 档 选错只能换 OPN,打样前必须核算
100 µs 禁止门槛 t_DIS_TIM 75~125 µs 慢波形/锁死信号都是“待机指令”
四种正常休眠态 UVLO/禁止/LLD/触发封锁 排查先排除正常休眠原因,不要急于更换 IC
自供电能量断续 105 mA 仅漏极高压期 电容不足 = 重载 UVLO 抖动
官方对比测试法 DS 图 72 使能/禁止对比 CCM 交叉导通的一手判据,直接可抄
热要按 TSOP6 算 250 °C/W 自供电压差损耗烧在片内,170 °C TSD 在等它

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